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国家自然科学基金(61076019)

作品数：9 被引量：10H指数：2
相关作者：吴宁葛芬周磊张颖黄辉更多>>
相关机构：南京航空航天大学扬州大学更多>>
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相关领域：自动化与计算机技术电子电信更多>>

文献类型

  • 9篇期刊文章
  • 1篇会议论文

领域

  • 5篇电子电信
  • 5篇自动化与计算...

主题

  • 7篇上网
  • 7篇片上网络
  • 7篇网络
  • 3篇英文
  • 3篇路由
  • 2篇延时
  • 2篇数据压缩
  • 2篇片上系统
  • 2篇路由算法
  • 2篇测试数据
  • 2篇测试数据压缩
  • 1篇低能耗
  • 1篇抖动
  • 1篇性能比较
  • 1篇性能分析
  • 1篇延迟时间
  • 1篇映射
  • 1篇增益
  • 1篇振荡器
  • 1篇振荡器设计

机构

  • 10篇南京航空航天...
  • 3篇扬州大学

作者

  • 10篇吴宁
  • 7篇葛芬
  • 3篇张颖
  • 3篇周磊
  • 1篇周芳
  • 1篇李云
  • 1篇陈鑫
  • 1篇穆屹峰
  • 1篇黄辉
  • 1篇段丽芬

传媒

  • 3篇Transa...
  • 1篇计算机集成制...
  • 1篇东南大学学报...
  • 1篇上海交通大学...
  • 1篇微电子学与计...
  • 1篇电子科技大学...
  • 1篇南京师范大学...

年份

  • 1篇2013
  • 3篇2012
  • 5篇2011
  • 1篇2010
共 9 条 记 录，以下是 1-10
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排序方式：
三维拓扑结构功耗和延时性能比较与评估
2011年
分析和比较了规则三维拓扑和自定义三维拓扑在功耗和延时性能上的特征,并对片上网络设计中的拓扑结构选择给出建议。根据当前三维拓扑结构设计热点,选择3D-mesh、3D-torus、插入长连线的自定义三维拓扑和多级三维拓扑作为分析对象,在分析四种拓扑结构特点和生成方法的基础上,给出功耗和延时性能评估模型,分别计算和仿真在不同规模和注入率应用下各种拓扑的延时和功耗结果,并进行比较。实验结果表明,插入长连线的三维拓扑适用于对延时要求严格的场合,采用多级网络的拓扑结构在功耗方面的性能超过其他拓扑结构,而规则拓扑在设计难度、延时和功耗方面有较好的折衷性。
周磊吴宁葛芬
关键词：片上网络延时功耗
3-D Spidergon:一种延时优化的通用三维片上网络拓扑生成方法(英文)被引量：2
2011年
提出一种基于Spidergon的通用三维拓扑结构及其拓扑生成方法。该方法在三维拓扑结构原型基础上,通过该拓扑的延时模型建立拓扑结构和延时时间的关系,并以此确定最小化延时时间条件下的拓扑结构。同时设计了针对该结构的自适应路由算法。该算法以纵向路由为优先方向,通过自适应寻找源节点和目的节点的等效最短路径提高网络吞吐量。仿真结果表明,同等规模的3-D Spidergon与3-Dmesh结构相比,在网络近似饱和的情况下,该拓扑的延时时间比3-Dmesh低17%,吞吐量高16.7%。
周磊吴宁葛芬
关键词：片上网络拓扑路由算法
增益恒定的数控振荡器设计被引量：3
2012年
针对驱动能力可调的数控振荡器在输出频率范围内增益变化较大的问题,提出了一种电路设计方法,通过该方法设计出的数控振荡器结构具有增益恒定的特点。在SMIC 0.18μm logic 1P6M CMOS工艺下设计并实现了一个采用该振荡器结构的数控锁相环,数控振荡器的面积为0.025 mm2。实测数据表明,该数控振荡器输出的频率范围为76～208 MHz。当锁相环输出208 MHz高频时钟时,四分频后的峰峰值抖动为110 ps,均方根抖动为14.82 ps,数控振荡器的功耗为1.512 mW。
陈鑫黄辉吴宁
关键词：延迟时间数控振荡器增益抖动
基于双通道的NoC路由器系统级设计
2012年
为提高路由器的并行处理能力,减少传输延时,提出并设计了一种包含GT通道与BE通道的双通道路由器.GT通道采用虚通道切换技术传输GT包,BE通道采用虫孔交换技术传输BE包,两通道之间的信号、存储、控制、传输都相互独立.在SystemC平台下进行系统级设计,采用XY维序路由算法、轮询仲裁机制、交换阵列开关控制矩阵的方法,完成数据包的路由与转发,实现GT包和BE包的并行传输.
段丽芬吴宁
关键词：片上网络SYSTEMC
优化型FDR码对SoC测试数据的压缩
测试数据压缩是So C测试中的关键问题之一,用于有效地减少测试数据总量。本文提出了一种新颖的的变长—变长压缩编码,称为AFDR(Advanced FDR)编码。它同时对0游程和1游程进行编码,并对等长游程赋以相同的编码,...
张颖吴宁葛芬
关键词：测试数据压缩系统芯片
文献传递
片上系统测试数据压缩的优化型FDR编码机制(英文)被引量：1
2012年
测试数据压缩是片上系统(System-on-chip,SoC)测试中的关键问题之一,用于有效地减少测试数据总量。本文提出了一种新颖的变长-变长压缩编码,称为AFDR(Advanced frequency-directed run-length)编码。它同时对0游程和1游程进行编码,并对等长游程赋以相同的编码,优化了仅仅考虑0游程的FDR(Frequency-directed run-length)码。此外,对游程长度为2的数据(即00和11)进行特殊处理,进一步地提高了压缩比。ISCAS89标准电路下的实验结果表明,AFDR编码的压缩效果明显优于FDR编码以及同类型的其他编码。
张颖吴宁葛芬
关键词：测试数据压缩片上系统
基于GA-MMAS算法的片上网络低能耗映射
2011年
针对片上网络的低能耗IP映射问题,提出了一种基于该混合算法的映射算法———GA-MMAS算法.该算法首先利用优先映射通讯量大的核的方法代替启发因子来确定启发信息,以改善最大最小蚁群算法(MMAS)的最优解,然后将MMAS与GA结合,利用GA的快速性得到MMAS初始信息素,来弥补MMAS的前期信息素匮乏的缺点,提高了最优解的精确性,从而得到通信能耗更低的映射结果.实验表明,该映射算法与初始映射相比,能耗可以节省36%～60%,与已有的GA,AS和MMAS相比分别能节省3%～25%,10%～30%和3%～30%的能耗.
穆屹峰吴宁葛芬
关键词：能耗混合算法映射片上网络
一种基于2D-mesh的片上网络无死锁容错路由算法被引量：3
2013年
为解决片上网络中的永久性故障问题,提出一种基于2D-mesh拓扑结构的无死锁容错路由算法.定义了新的故障块生成规则,减小了故障节点的区域和受影响的健康节点数目,设计了一种故障节点探测和绕道路径生成算法,通过递归式消息传递实现了故障块区域的建立和绕道路径列表的生成.在绕道容错路由算法中,采用部分路由表与路由规则相结合的方法,通过在报头中加入绕道路径列表的方式引导报文绕过故障区域.结果表明,与现有算法相比,所提出的容错路由算法在随机均衡负载和热点负载2种情况下的延时都有所降低.
周磊吴宁李云
关键词：片上网络路由算法容错
片上网络体系结构仿真和性能分析(英文)
2010年
片上网络(Network on chip,NoC)是复杂片上系统(System on chip,SoC)设计中通信问题的解决方案。本文介绍了多种NoC体系结构,并提出了一种基于OPNET的高层次建模和仿真方法,以根据平均延时和吞吐量评估体系结构性能。本文在不同通信负载和通信模式下对NoC体系结构进行了仿真实验,对比分析的实验结果可为特定应用的NoC设计中选择最佳互连体系结构提供依据。最后通过MPEG4解码器映射到各种NoC体系结构的应用,进一步证明了该仿真评估方法的有效性。
葛芬吴宁
关键词：体系结构片上网络片上系统性能分析
面向传输延时的片上网络缓冲区分配算法被引量：1
2011年
针对优化片上网络数据包传输延时的问题,提出了一种在缓冲资源限制条件下的缓冲区分配算法.该算法在建立二维网格结构的片上网络通信模型的基础上,依据各节点之间的通信流量,估算出节点中各输入通道的负载大小,再根据其负载情况采用模拟退火算法实现缓冲区资源的分配.实验结果表明,该算法可以更加合理地分配缓冲区资源,有效降低数据的传输延时.在均匀通信流量下,可降低传输延时11.3%～56.4%;在单热点通信流量和双热点通信流量下,可分别降低传输延时13.2%～76.9%和13.7%～79.1%.
周芳吴宁张颖葛芬
关键词：片上网络模拟退火算法
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