上海市青年科技启明星计划(11QA1400500)
- 作品数：3 被引量：1H指数：1
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- 基于65nm工艺的高性能低功耗处理器设计
- 2012年
- 研究并设计一款RISC处理器,从架构设计、电路设计、芯片后端设计多个层次保证其高性能、低功耗的特点。在架构设计层面,通过扩展寄存器堆来提升数据交互的局部性并降低对存储器的访问次数。在电路设计层面,利用动态门控时钟技术对乘除法模块和寄存器堆进行高效的时钟控制。在芯片后端设计层面,分析并比较TSMC 65 nm中GP和LP 2种工艺库,采用多阈值设计流程进一步提高处理器的速度并降低功耗。测试结果表明,与其他平台下的性能结果相比,该处理器可以将RS前向纠错解码算法的吞吐率提高4倍~70倍。
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- 关键词：门控时钟多阈值
- 基于多核平台的长期演进信道估计器设计
- 2013年
- 设计一种基于多核平台的长期演进下行链路信道估计器。对任务进行划分,分解为多个子任务,根据子任务之间的相对通信量,将子任务映射至13个处理器核上,综合运用共享内存及NoC消息传递2种方式进行核间通信,实现多核协同工作,并使用扩展的寄存器堆文件、SIMD数据通路特性、平衡单核计算负载量等方式优化设计。性能分析结果表明,该信道估计器可达到678 Mb/s的吞吐率。
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- 关键词：信道估计器多核处理器长期演进核间通信
- 基于扩展寄存器与片上网络的运算阵列设计被引量：1
- 2013年
- 为提高多核处理器性能,在传统硬件加速部件的基础上,提出一种新型的运算阵列设计方案。将运算阵列与多核处理器的通信端口映射在扩展寄存器地址空间上,实现阵列与多核处理器的紧密耦合。通过片上网络连接各个运算单元,实现运算阵列的灵活配置和高度共享。在实验系统上实现1 024点快速傅里叶变换和H.264解码器,结果表明,与纯软件实现相比,该方案能使处理器性能和功耗都有所改善。
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- 关键词：多核处理器片上网络快速傅里叶变换
