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国家高技术研究发展计划(2002AA1Z1120)
作品数:
1
被引量:4
H指数:1
相关作者:
朱晓冬
王世明
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相关机构:
上海交通大学
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发文基金:
国家高技术研究发展计划
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相关领域:
电子电信
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处理器架构
机构
1篇
上海交通大学
作者
1篇
王世明
1篇
朱晓冬
传媒
1篇
计算机工程
年份
1篇
2005
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多时钟域处理器架构的性能和功耗分析
被引量:4
2005年
研究一种新的多时钟域的处理器架构,它把处理器分成几个工作在不同时钟下的时钟域,每个域有自己独立的工作电压和时钟频率,可以大大缓解高速处理器设计中最棘手的全局时钟分布问题,并且每个域的工作电压和工作频率可以根据应用的实际需求动态地调整,可以平均节省约20%的功耗。此外分析了全局异步局部同步时钟方案的结构及电压和工作频率调整的算法,并给出用SimpleScalar和Wattch仿真工具得到的仿真结果。
朱晓冬
王世明
关键词:
处理器
多时钟域
低功耗
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