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王俊宇
作品数:
4
被引量:4
H指数:1
供职机构:
北京科技大学计算机与通信工程学院计算机科学与技术系
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发文基金:
国家高技术研究发展计划
教育部“优秀青年教师资助计划”
高等学校骨干教师资助计划
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相关领域:
自动化与计算机技术
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合作作者
夏宏
北京科技大学计算机与通信工程学...
王昭顺
北京科技大学计算机与通信工程学...
吴克河
华北电力大学控制与计算机工程学...
王新辉
北京科技大学计算机与通信工程学...
王沁
北京科技大学计算机与通信工程学...
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4篇
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自动化与计算...
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并行处理
机构
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北京科技大学
1篇
华北电力大学
作者
4篇
王俊宇
2篇
王昭顺
2篇
夏宏
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王许书
1篇
王沁
1篇
吴克河
1篇
王新辉
传媒
3篇
计算机工程与...
1篇
计算机工程
年份
4篇
2001
共
4
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细粒度显式并行体系结构微处理器设计
被引量:1
2001年
文章在分析微处理器体系结构发展的基础上,利用文献[1]提出的显式硬件单元控制EHCC技术,设计了一个细粒度显式并行计算微处理器模型。仿真结果表明细粒度显式并行计算将是微处理器体系结构发展的理想方向。
王昭顺
王俊宇
王新辉
关键词:
微处理器
体系结构
基于最小操作单元的VLIW微处理器设计
被引量:1
2001年
提出一种微处理器体系结构发展的分析方法—粒度分析方法,并用这种方法分析了微处理器体系结构的发展趋势。在此基础上提出基于最小操作单元MOUB微处理器体系结构的设计思想,并设计实现了一个这种结构的微处理器模型。
王昭顺
王许书
王俊宇
关键词:
微处理器
VLIW
体系结构
粒度分析
寄存器队列装置及其设计方法
被引量:2
2001年
介绍了寄存器堆队列装置(FIFO)的作用和设计原理。传统寄存器队列的设计多采用串行输入一串行输出,或者并行输入-并行输出的方式,该文介绍了两种并行输入-并行输出而且可以“边进边出”的寄存器队列装置,该装置可用于总线接口和先行控制处理机的设计中。
王俊宇
夏宏
吴克河
关键词:
微处理器
寄存器堆
数据缓冲
最新ILP微处理器的设计特点及分析
被引量:1
2001年
文章综述了指令级并行(ILP)微处理器的特点,着重介绍了第七代X86、Itanium、E2K等ILP微处理器的体系结构和所采用的新技术,分析了它们各自的特点和问题,并对ILP微处理器的发展方向进行了探讨。
王俊宇
夏宏
王沁
关键词:
微处理器
体系结构
指令级并行
并行处理
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