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王镇

作品数：29 被引量：10H指数：2
供职机构：东南大学更多>>
发文基金：国家自然科学基金更多>>
相关领域：电子电信经济管理文学更多>>

合作作者

文献类型

  • 21篇专利
  • 5篇学位论文
  • 3篇期刊文章

领域

  • 7篇电子电信
  • 2篇经济管理
  • 1篇文学

主题

  • 9篇电路
  • 7篇时钟
  • 7篇分频
  • 5篇信号
  • 5篇时钟信号
  • 4篇总线
  • 4篇芯片
  • 4篇花屏
  • 4篇分频电路
  • 4篇分频器
  • 4篇处理器
  • 3篇电路设计
  • 3篇电路系统
  • 3篇音频
  • 3篇整体性能
  • 3篇数模
  • 3篇数字音频
  • 3篇专用集成电路
  • 3篇专用集成电路...
  • 3篇接口

机构

  • 29篇东南大学

作者

  • 29篇王镇
  • 19篇刘新宁
  • 11篇杨军
  • 8篇孙华芳
  • 4篇赵梦南
  • 4篇王学香
  • 4篇袁璐
  • 3篇单伟伟
  • 3篇卢玉超
  • 3篇孙亚芳
  • 3篇郭浩杰
  • 3篇时龙兴
  • 3篇王政
  • 3篇任玉洁
  • 3篇张亚伟
  • 3篇戴晨
  • 2篇杨胜远
  • 2篇牛玉祥
  • 2篇刘淦
  • 2篇胥月

传媒

  • 1篇电路与系统学...
  • 1篇电子器件
  • 1篇现代电子技术

年份

  • 2篇2018
  • 4篇2015
  • 1篇2014
  • 8篇2013
  • 6篇2012
  • 4篇2011
  • 1篇2006
  • 2篇2005
  • 1篇2004
共 29 条 记 录，以下是 1-10
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排序方式：
镇江市引航道水利枢纽工程项目进度管理研究
项目管理人员进行项目管理的主要任务之一就是让建设工程项目按时按质的达到预期目标，如期完成目标任务。因此，项目的进度控制就成为项目管理的重要工作，既完成合同约定建设任务和时间的关键手段，也是项目管理活动过程中必不可少的重要...
王镇
关键词：水利枢纽工程项目管理进度控制风险分析
文献传递
一种LCD控制器及其显示控制方法
一种LCD控制器及其显示控制方法，LCD控制器包括SLAVE从机模块、DMA通道模块、FIFO缓存器、数据格式变换模块、3D处理模块、OVERLY多层叠加模块、DISP FIFO显示缓存模块和时序模块，支持裸眼立体可视、...
任玉洁卢玉超刘新宁王镇孙亚芳杨军时龙兴
文献传递
一种低延时数字时钟分频电路
一种低延时数字时钟分频电路，设有多级分频器，各级分频器均含有一级寄存器和一个计数逻辑器，多级分频器以并联形式排列，即多级分频器的输入时钟都为第一级的输入时钟，设置分频参数改变检测电路以及分频参数换算逻辑电路，分频参数改变...
刘新宁王镇杨军赵梦南孙华芳王学香
文献传递
一种GPS接收机专用32点FFT变换芯片结构及实现方法
本发明公开了一种GPS接收机专用32点FFT变换芯片结构及实现方法。该32点FFT变换芯片结构包括旋转因子存储单元和32点基-2FFT运算单元，旋转因子存储单元连接32点基-2FFT运算单元；32点基-2FFT运算单元为...
戚隆宁杨胜远王镇卢培牛玉祥虞海宇蔡伟
文献传递
I2S接口时钟电路的分频电路
一种串行数字音频总线I2S接口时钟电路的分频电路，包括串行时钟SCLK产生模块SCLK_GEN、字段选择信号WS产生模块WS_GEN和配置分频因子模块DIV_GEN；所述配置分频因子模块DIV_GEN的第一分频因子N1和...
刘新宁王镇杨军孙声震张亚伟
文献传递
GNSS导航基带信号捕获算法与电路关键技术研究
近年来，智能手机、智能手表、运动手环等移动设备逐渐兴起，定位导航部件是其重要功耗来源。而其中捕获引擎是全球定位系统接收机中的主要高能耗单元，因此降低捕获引擎功耗对于增强卫星导航系统（GNSS）接收机续航能力尤为重要。本文...
王镇
关键词：卫星导航系统基带信号能量效率
I2S接口时钟电路的分频电路
一种串行数字音频总线I2S接口时钟电路的分频电路，包括串行时钟SCLK产生模块SCLK_GEN、字段选择信号WS产生模块WS_GEN和配置分频因子模块DIV_GEN；步骤1）DIV_GEN根据I2S主时钟MCLK频率值F...
刘新宁王镇杨军曹华洋孙声震张亚伟
一种LCD控制器
一种LCD控制器包括SLAVE从机模块、DMA通道模块、FIFO缓存器、数据格式变换模块、3D处理模块、OVERLY多层叠加模块、DISP FIFO显示缓存模块和时序模块，外部处理器通过AHB接口输出连接至SLAVE从机...
任玉洁卢玉超刘新宁王镇孙亚芳杨军时龙兴
文献传递
防毛刺时钟选择器的时序优化方法及其电路
一种防毛刺时钟选择器的时序优化方法及其电路，防毛刺时钟选择器设有两路时钟信号输入端、时钟选择信号控制端、复位信号端、一个非门以及第一、第二两个与门，第一与门后续连接第一、第二两级寄存器，第二与门后续连接第三、第四两级寄存...
王镇刘新宁杨军赵梦南孙华芳王学香
文献传递
基于ARMulator扩展的AMBA总线及性能分析
2006年
系统芯片面临的重大挑战在于设计之初对软硬件进行划分,并对系统的性能评估。针对这一挑战,阐述在ARM指令集模拟器基础上扩展片上总线(AMBA)模型、SDRAM控制器模型和SDRAM模型。实验结果显示,对MPEG4解码算法进行软硬件划分,采用模型可以准确地评估MPEG 4解码系统的性能和功耗。
杨军王镇
关键词：AMBA总线SDRAM控制器MPEGARM
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