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张湘贤

作品数：1 被引量：1H指数：1
供职机构：西南科技大学信息工程学院更多>>
发文基金：四川省科技计划项目国防科工局核能开发项目更多>>
相关领域：电子电信更多>>

合作作者

题名
作者

文献类型

  • 1篇中文期刊文章

领域

  • 1篇电子电信

主题

  • 1篇译码
  • 1篇译码器
  • 1篇译码器设计
  • 1篇阵列
  • 1篇现场可编程
  • 1篇现场可编程门...
  • 1篇门阵列
  • 1篇可编程门阵列
  • 1篇格雷码
  • 1篇BCH
  • 1篇FPGA实现

机构

  • 1篇西南科技大学

作者

  • 1篇魏东梅
  • 1篇杨涛
  • 1篇张湘贤
  • 1篇向玲

传媒

  • 1篇计算机应用

年份

  • 1篇2012
共 1 条 记 录，以下是 1-1
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排序方式：
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并行高效BCH译码器设计及FPGA实现被引量：1
2012年
针对并行BCH译码器的特点,采用异或门实现有限域上常系数乘法,从而降低硬件复杂度。先计算部分错误位置多项式,再根据仿射多项式和格雷码理论,进行逻辑运算得到剩余的错误位置多项式,从而减少了系统所占用的资源。在现场可编程门阵列(FPGA)开发软件ISE10.1上进行了时序仿真,验证了该算法时间和空间的高效性。
张湘贤杨涛魏东梅向玲
关键词：现场可编程门阵列格雷码
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