尤凯迪
- 作品数：8 被引量：6H指数：2
- 供职机构：复旦大学信息科学与工程学院专用集成电路与系统国家重点实验室更多>>
- 发文基金：国家自然科学基金国家重点实验室开放基金教育部科学技术研究重点项目更多>>
- 相关领域：自动化与计算机技术自然科学总论电子电信更多>>
- 安全的NoC系统的VLSI设计
- 随着工艺的不断发展，一个芯片上能集成的IP核数目越来越多，基于共享总线的系统随着IP核数目的增加，IP核对有限的总线资源的竞争更加激烈，严重地影响了核间通信的效率。片上网络(NoC)由于能够为IP核之间提供可靠、灵活、高...
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- 关键词：片上网络
- 文献传递
- 基于65nm工艺的高性能低功耗处理器设计
- 2012年
- 研究并设计一款RISC处理器,从架构设计、电路设计、芯片后端设计多个层次保证其高性能、低功耗的特点。在架构设计层面,通过扩展寄存器堆来提升数据交互的局部性并降低对存储器的访问次数。在电路设计层面,利用动态门控时钟技术对乘除法模块和寄存器堆进行高效的时钟控制。在芯片后端设计层面,分析并比较TSMC 65 nm中GP和LP 2种工艺库,采用多阈值设计流程进一步提高处理器的速度并降低功耗。测试结果表明,与其他平台下的性能结果相比,该处理器可以将RS前向纠错解码算法的吞吐率提高4倍~70倍。
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- 关键词：门控时钟多阈值
- MIPS内存管理单元的设计与实现被引量：2
- 2010年
- 设计MIPS324kc处理器内存管理单元(MMU),该模块对处理器地址进行合法性检查,并按照不同的地址空间对虚拟地址进行静态或动态映射。在硬件上采用三级流水线方式实现JTLB,并为处理器指令端口和数据端口设计相应的快表以提高TLB的查询速度。MMU与总线接口模块的时序采用简化的AMBA协议,与处理器进行联合调试并运行Linux操作系统,同时在功能上通过FPGA验证。该模块经过DC综合后,面积约为32K等效逻辑门。
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- 关键词：内存管理单元MIPS处理器
- 基于多核平台的RS译码器
- 2012年
- 提出一种基于多核平台的Reed-Solomon(RS)译码器。为提高译码器的数据吞吐率,分析RS译码算法的特点,在多核层次上进行任务划分,并在SIMD单核层次上进行数据并行处理,以减少存储器访问次数,最小化核间通信,通过多核平台实现RS(255,239,8)。实验结果表明,当码率最差时,该译码器的吞吐率仍可达到4.35 Gb/s。
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- 关键词：多核处理器并行计算映射策略
- 适用于多核处理器的簇状片上网络设计被引量：2
- 2011年
- 提出一种新型簇状片上网络架构。该架构以二维网状拓扑结构连接各个簇单元,每个簇单元由3个处理器、1个直接访存单元和1个簇共享存储单元组成。基于该架构的多核处理器可以获得更高的通信效率及存储器利用率。在实验系统上实现3 780点的快速傅里叶变换,结果表明,在快速傅里叶变换应用中存储器的利用率能提升至79.5%。
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- 关键词：片上网络多核处理器直接内存访问
- 一种多核处理器核间通信方法及其电路结构
- 本发明属于高性能处理器技术领域，具体为一种多核处理器核间通信方法及其电路结构。本发明通过对现有多核处理器架构中的寄存器电路模块进行功能性扩展，在该模块中添加多核处理器核间通信地址映射单元，从而能够通过访问寄存器地址实现对...
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- 文献传递
- 高性能低功耗多核处理器研究
- 通信与多媒体等领域对电子产品性能、功耗、设计周期、灵活性的特定要求,决定了专用集成电路或者基于单个处理器的片上系统都不是很好的解决方案。而多核处理器则依靠其优秀的性能、通用性、灵活性成为了一个理想的选择,所以它也是当前学...
- 尤凯迪
- 关键词：多核处理器片上网络
- 适用于多核处理器的扩展寄存器文件设计
- 2012年
- 针对处理器中可用寄存器数量有限的问题,提出一种适用于多核处理器的扩展寄存器文件设计方案。采用多组结构进行硬件设计,将通信端口映射在扩展寄存器地址空间上,以实现寄存器寻址核间通信机制,引入兼具底层指令与高层封装的混合软件配置方案,改进软件编译流程。评估结果表明,该方案将可用寄存器文件的数量增加一倍,核间通信指令数目减少50%,系统吞吐率得到优化。
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- 关键词：多核处理器核间通信LDPC译码器
