肖瑞瑾
- 作品数：7 被引量：7H指数：2
- 供职机构：复旦大学更多>>
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- 相关领域：自动化与计算机技术自然科学总论更多>>
- 适用于多核处理器的簇状片上网络设计被引量：2
- 2011年
- 提出一种新型簇状片上网络架构。该架构以二维网状拓扑结构连接各个簇单元,每个簇单元由3个处理器、1个直接访存单元和1个簇共享存储单元组成。基于该架构的多核处理器可以获得更高的通信效率及存储器利用率。在实验系统上实现3 780点的快速傅里叶变换,结果表明,在快速傅里叶变换应用中存储器的利用率能提升至79.5%。
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- 关键词：片上网络多核处理器直接内存访问
- 面向通信和多媒体应用的单指令多数据处理器电路结构
- 本发明属于高性能并行计算处理器技术领域，具体为一种面向通信和多媒体应用的单指令多数据处理器电路结构。包括SIMD整数运算单元、流水线控制单元、处理器异常控制单元、SIMD乘除法运算单元和适用于SIMD运算的扩展寄存器文件...
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- 基于65nm工艺的高性能低功耗处理器设计
- 2012年
- 研究并设计一款RISC处理器,从架构设计、电路设计、芯片后端设计多个层次保证其高性能、低功耗的特点。在架构设计层面,通过扩展寄存器堆来提升数据交互的局部性并降低对存储器的访问次数。在电路设计层面,利用动态门控时钟技术对乘除法模块和寄存器堆进行高效的时钟控制。在芯片后端设计层面,分析并比较TSMC 65 nm中GP和LP 2种工艺库,采用多阈值设计流程进一步提高处理器的速度并降低功耗。测试结果表明,与其他平台下的性能结果相比,该处理器可以将RS前向纠错解码算法的吞吐率提高4倍~70倍。
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- 关键词：门控时钟多阈值
- 一种多核处理器核间通信方法及其电路结构
- 本发明属于高性能处理器技术领域，具体为一种多核处理器核间通信方法及其电路结构。本发明通过对现有多核处理器架构中的寄存器电路模块进行功能性扩展，在该模块中添加多核处理器核间通信地址映射单元，从而能够通过访问寄存器地址实现对...
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- 文献传递
- 多核处理器层次化存储体系研究
- 近年来,以平板电脑、智能手机为代表的手持式消费电子产品获得了前所未有的快速发展机遇,随着产品的不断升级,不断提升的硬件配置水平带动功耗需求不断走高。处理器作为消费电子产品的核心部件,其技术需求特征逐渐从高性能转向高性能与...
- 肖瑞瑾
- 关键词：多核处理器嵌入式应用低功耗设计核间通信
- 文献传递
- 面向通信和多媒体应用的单指令多数据处理器电路结构
- 本发明属于高性能并行计算处理器技术领域，具体为一种面向通信和多媒体应用的单指令多数据处理器电路结构。包括SIMD整数运算单元、流水线控制单元、处理器异常控制单元、SIMD乘除法运算单元和适用于SIMD运算的扩展寄存器文件...
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- 文献传递
- 适用于多核处理器的扩展寄存器文件设计
- 2012年
- 针对处理器中可用寄存器数量有限的问题,提出一种适用于多核处理器的扩展寄存器文件设计方案。采用多组结构进行硬件设计,将通信端口映射在扩展寄存器地址空间上,以实现寄存器寻址核间通信机制,引入兼具底层指令与高层封装的混合软件配置方案,改进软件编译流程。评估结果表明,该方案将可用寄存器文件的数量增加一倍,核间通信指令数目减少50%,系统吞吐率得到优化。
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- 关键词：多核处理器核间通信LDPC译码器
