李章全
- 作品数：13 被引量：23H指数：2
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- 降压PWM DC/DC开关稳压系统仿真分析
- 2008年
- 集成CMOS脉冲宽度调制开关电源系统因为高效率、高集成度等优点在通信、计算机系统方面被广泛应用。文中通过分析建立一个PWMDC/DC稳压系统的闭环响应传输函数,研究如何在瞬态响应速度和稳定性方面进行取舍;在此基础上用Matlab建立小信号模型仿真,并通过Hspice实现仿真验证。
- 刘元丰周健君李章全
- 关键词：电源管理
- 小数频率合成器噪声传函及动态特性建模仿真
- 2008年
- 对采用Δ-Σ小数分频频率合成器(Δ-ΣPLL)中离散采样行为进行了深入研究,提出了混合信号系统的传输函数表达式,并将该表达式运用在现有的锁相环时域模型之上,获得了环路中量化噪声以及压控振荡器(VCO)的噪声传输函数模型。此外,论述了一种简化计算方法用于获得三阶锁相环动态参数,并对Δ-ΣPLL噪声和闭环带宽的折衷进行了建模与仿真。
- 胡悦李章全周健军
- 关键词：混合信号系统噪声特性
- 应用于USB2.0的CMOS锁相环设计
- 2008年
- 以应用于USB2.0接收端的480MHz锁相环作为设计实例,阐述了锁相环集成电路设计的要素,给出了模块设计思路和仿真波形,并比较了集成电路和印制板电路锁相环的设计方法,展示两种设计思路上的共性和差异。
- 潘瑞雪周健军李章全
- 关键词：锁相环集成电路CMOS印制板电路
- 压控振荡器相位噪声的一种建模研究方法被引量：1
- 2010年
- 电感电容压控振荡器(LC-VCO)是无线收发电路中的重要单元,它的频谱纯洁度将直接影响频率合成后的信号频谱,所以相位噪声是VCO的最重要的指标之一。提出了一种研究LC-VCO相位噪声的方法,使用VerilogA语言建立可控噪声和可控寄生电容的晶体管模型,通过用所建立的模型代替原有的spice晶体管模型来构成LC-VCO电路并进行仿真,能够对噪声和寄生电容进行开关控制,从而观察不同的噪声源以及不同的寄生特性对电路相位噪声的影响。使用该晶体管模型,仿真验证了噪声滤波理论中差分对管结电容对最优电感值选取的影响以及滤波电感对白噪声和闪烁噪声不同的抑制作用。
- 胡晓莉李章全李萍
- 关键词：LC-VCO相位噪声寄生电容
- SAR A/D转换器中电容失配问题的分析被引量：13
- 2007年
- 在逐次逼近型(SAR)A/D转换器的设计过程中,电容网络的匹配精度对A/D转换器系统精度有着至关重要的影响。详细推导了电容失配误差与A/D转换器精度的关系表达式,给出了严密的理论证明,为电路设计人员选择工艺、版图方式、电路结构和电容大小提供了有力的理论基础。此论证方式也适用于电阻网络等其他二进制加权网络的精度计算。
- 周文婷李章全
- 关键词：电容失配
- 一种6GHz 831μA除以10/11双模分频器
- 2009年
- 本文基于目前流行的TSPC高速电路,利用状态机原理提出了一种可实现任意分频比的射频双模预分频器电路;并且提供了分频比为10/11的具体实现电路。在这个除以10/11分频器当中,基本的D触发器单元采用了目前流行的高速TSPC与E-TSPC结构,同时具备低功耗和高输入频率的特点。电路采用SMIC0.18μ mRFCMOS工艺,利用Cadence Spectre仿真显示,采用1.8V电源电压供电,环境温度为27℃时,最高的工作频率可达到6GHz,此时整个分频器消耗的电流仅为831μA。
- 朱凯周健军李章全
- 关键词：预分频器频率合成器
- 基于自偏置技术的低噪声锁相环研究
- 2013年
- 文中描述了一种自偏置型锁相环电路,通过采用环路自适应的方法得到一个固定的阻尼系数ξ以及带宽和输入频率的比值ωN/ωREF,从而保证环路的稳定。传统锁相环电路设计需要一个固定的电荷泵充放电电流和固定的VCO增益,这样才能保持系统的稳定性。但是当工艺发展到深亚微米尤其是65 nm以下的时候,芯片的供电电压都在1 V以下且器件的二级效应趋于严重,此时要得到一个固定的电流值或者固定的VCO增益是很困难的。自偏置锁相环解决了这个问题,由于采用了自适应环路的设计方法,使得系统受工艺、温度和电压的影响非常小,而且锁定范围更大。可以广泛应用于时钟发生器以及通信系统。芯片采用SMIC标准低漏电55 nm CMOS工艺制造,测试均方抖动为3.8 ps,峰-峰值抖动25 ps。
- 曹羽欧李章全
- 关键词：压控振荡器低噪声
- CMOS带隙基准电压源的设计被引量：2
- 2008年
- 许多模拟电路需要性能较好的带隙基准电压源,如ADC,DAC等。对工艺、电源电压、负载变化不敏感的带隙基准电压源在模拟电路中得到了广泛的应用。现详细分析并说明了设计这样的带隙基准电压源电路需要考虑的问题。
- 戚琦李章全周健军
- 关键词：带隙基准电压源温度系数频率响应
- 全差分高速低电压锁存比较器的设计被引量：3
- 2009年
- 全差分锁存比较器在各种模数转换器中有着广泛的应用,其失调电压对于模数转换的精度有着直接的影响。本文提出了一种全差分高速低电压锁存比较器,着重对其失调电压和速度进行了优化。在0.25μm标准CMOS IHP工艺条件下,采用了Cadence Spectre进行了仿真,结果表明,当工作频率为200MHz,供电电压为1.5V,延时仅为1.81ns,失调电压为27.69mV。
- 姚远李萍李章全
- 关键词：全差分锁存比较器失调电压蒙特卡洛仿真
- 一种新型7.5GHz 3.4mA相位切换三模预分频器被引量：2
- 2008年
- 提出了一种新型基于相位选择结构的三模预分频器,与传统结构相比,提供了更多可选的分频比和更宽的输出频率覆盖范围,同时不增加电路复杂度与功耗,可以应用于支持多种无线标准的超高频频率合成器。设计采用了TSMC 0.18μm Analog/RF CMOS工艺,电源电压2.0V。仿真结果表明,电路最高工作频率为7.5GHz,最大电流消耗小于3.4mA。
- 曲勃周健军莫亭亭李章全
- 关键词：频率合成器预分频器相位切换
